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Mnemonico_DCFSNZ.asm
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Mnemonico_DCFSNZ.asm
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#INCLUDE <P18F4550.INC>
; CONFIG1L
CONFIG PLLDIV = 1 ; PLL Prescaler Selection bits (No prescale (4 MHz oscillator input drives PLL directly))
CONFIG CPUDIV = OSC1_PLL2 ; System Clock Postscaler Selection bits ([Primary Oscillator Src: /1][96 MHz PLL Src: /2])
CONFIG USBDIV = 1 ; USB Clock Selection bit (used in Full-Speed USB mode only; UCFG:FSEN = 1) (USB clock source comes directly from the primary oscillator block with no postscale)
; CONFIG1H
CONFIG FOSC = HS ; Oscillator Selection bits (HS oscillator (HS))
CONFIG FCMEN = OFF ; Fail-Safe Clock Monitor Enable bit (Fail-Safe Clock Monitor disabled)
CONFIG IESO = OFF ; Internal/External Oscillator Switchover bit (Oscillator Switchover mode disabled)
; CONFIG2L
CONFIG PWRT = OFF ; Power-up Timer Enable bit (PWRT disabled)
CONFIG BOR = ON ; Brown-out Reset Enable bits (Brown-out Reset enabled in hardware only (SBOREN is disabled))
CONFIG BORV = 3 ; Brown-out Reset Voltage bits (Minimum setting 2.05V)
CONFIG VREGEN = OFF ; USB Voltage Regulator Enable bit (USB voltage regulator disabled)
; CONFIG2H
CONFIG WDT = OFF ; Watchdog Timer Enable bit (WDT disabled (control is placed on the SWDTEN bit))
CONFIG WDTPS = 32768 ; Watchdog Timer Postscale Select bits (1:32768)
; CONFIG3H
CONFIG CCP2MX = OFF ; CCP2 MUX bit (CCP2 input/output is multiplexed with RB3)
CONFIG PBADEN = OFF ; PORTB A/D Enable bit (PORTB<4:0> pins are configured as digital I/O on Reset)
CONFIG LPT1OSC = OFF ; Low-Power Timer 1 Oscillator Enable bit (Timer1 configured for higher power operation)
CONFIG MCLRE = ON ; MCLR Pin Enable bit (MCLR pin enabled; RE3 input pin disabled)
;***************** MNEMONICO DCFSNZ F, D ****************************
;El presente mnemonico es muy similar a su contraparte DECFSZ, pero a diferencia suya
;este salta a cada que el decremento no sea igual a 0.
;Esto debido al significado del mismo
; DCFSNZ => DeCrement File Skip if it's Not Z => Decrementar el registro, saltar si este no es 0.
;********** RESOLUCIÓN ****************
CBLOCK 0x00
variablePrueba; Mantenemos nuestra variable para las pruebas
varSuma ;Creamos una variable de suma
ENDC
ORG 0X000
GOTO MAIN
ORG 0X008
GOTO INT_ALTA_PRIOR
ORG 0X018
GOTO INT_BAJA_PRIOR
ORG 0X020
MAIN:
CLRF TRISD ; Movemos el dato 0x00 en TRISD haciendo que sea salida
START:
MOVLW .5 ;Movemos un dato literal decimal al registro W
MOVWF variablePrueba;Movemos el dato de W hacia variablePrueba
COMPAR:
DCFSNZ variablePrueba, F;Decrementamos el registro W y saltamos mientras no sea 0
GOTO ZERO; Si es 0 vamos a la dirección de memoria con el alias ZERO
GOTO NOT_ZERO; De no ser 0 vamos a la dirección de memoria con el alias NOT_ZERO
ZERO:
SETF LATD; Cuando sea 0XFF ponemos al registro LATD
GOTO START; Y volvemos a la posicion de memoria con el alias START
NOT_ZERO:
CLRF LATD; De no ser 0 limpiamos el registro LATD
GOTO COMPAR; Volvemos a la dirección de memoria con el alias COMPAR
;para seguir con el "decremento comparativo"
ORG 0X0C0
INT_ALTA_PRIOR:
RETFIE
ORG 0X0F0
INT_BAJA_PRIOR:
RETFIE
END