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Fitter report for Test1
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Quartus II 32-bit Version 12.0 Build 263 08/02/2012 Service Pack 2 SJ Web Edition
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; Table of Contents ;
---------------------
1. Legal Notice
2. Fitter Summary
3. Fitter Settings
4. Parallel Compilation
5. Incremental Compilation Preservation Summary
6. Incremental Compilation Partition Settings
7. Incremental Compilation Placement Preservation
8. Pin-Out File
9. Fitter Resource Usage Summary
10. Fitter Partition Statistics
11. Input Pins
12. Output Pins
13. I/O Bank Usage
14. All Package Pins
15. Output Pin Default Load For Reported TCO
16. Fitter Resource Utilization by Entity
17. Delay Chain Summary
18. Pad To Core Delay Chain Fanout
19. Control Signals
20. Global & Other Fast Signals
21. Non-Global High Fan-Out Signals
22. Interconnect Usage Summary
23. LAB Logic Elements
24. LAB-wide Signals
25. LAB Signals Sourced
26. LAB Signals Sourced Out
27. LAB Distinct Inputs
28. Fitter Device Options
29. Operating Settings and Conditions
30. Fitter Messages
----------------
; Legal Notice ;
----------------
Copyright (C) 1991-2012 Altera Corporation
Your use of Altera Corporation's design tools, logic functions
and other software and tools, and its AMPP partner logic
functions, and any output files from any of the foregoing
(including device programming or simulation files), and any
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Subscription Agreement, Altera MegaCore Function License
Agreement, or other applicable license agreement, including,
without limitation, that your use is for the sole purpose of
programming logic devices manufactured by Altera and sold by
Altera or its authorized distributors. Please refer to the
applicable agreement for further details.
+------------------------------------------------------------------------------------+
; Fitter Summary ;
+------------------------------------+-----------------------------------------------+
; Fitter Status ; Successful - Fri Oct 07 16:43:58 2016 ;
; Quartus II 32-bit Version ; 12.0 Build 263 08/02/2012 SP 2 SJ Web Edition ;
; Revision Name ; Test1 ;
; Top-level Entity Name ; Test1 ;
; Family ; Cyclone II ;
; Device ; EP2C5T144C8 ;
; Timing Models ; Final ;
; Total logic elements ; 451 / 4,608 ( 10 % ) ;
; Total combinational functions ; 449 / 4,608 ( 10 % ) ;
; Dedicated logic registers ; 134 / 4,608 ( 3 % ) ;
; Total registers ; 134 ;
; Total pins ; 32 / 89 ( 36 % ) ;
; Total virtual pins ; 0 ;
; Total memory bits ; 0 / 119,808 ( 0 % ) ;
; Embedded Multiplier 9-bit elements ; 0 / 26 ( 0 % ) ;
; Total PLLs ; 0 / 2 ( 0 % ) ;
+------------------------------------+-----------------------------------------------+
+----------------------------------------------------------------------------------------------------------------------------------------------+
; Fitter Settings ;
+----------------------------------------------------------------------------+--------------------------------+--------------------------------+
; Option ; Setting ; Default Value ;
+----------------------------------------------------------------------------+--------------------------------+--------------------------------+
; Device ; EP2C5T144C8 ; ;
; Minimum Core Junction Temperature ; 0 ; ;
; Maximum Core Junction Temperature ; 85 ; ;
; Fit Attempts to Skip ; 0 ; 0.0 ;
; Device I/O Standard ; 3.3-V LVTTL ; ;
; Use smart compilation ; Off ; Off ;
; Enable parallel Assembler and TimeQuest Timing Analyzer during compilation ; On ; On ;
; Enable compact report table ; Off ; Off ;
; Auto Merge PLLs ; On ; On ;
; Ignore PLL Mode When Merging PLLs ; Off ; Off ;
; Router Timing Optimization Level ; Normal ; Normal ;
; Placement Effort Multiplier ; 1.0 ; 1.0 ;
; Router Effort Multiplier ; 1.0 ; 1.0 ;
; Always Enable Input Buffers ; Off ; Off ;
; Optimize Hold Timing ; IO Paths and Minimum TPD Paths ; IO Paths and Minimum TPD Paths ;
; Optimize Multi-Corner Timing ; On ; On ;
; PowerPlay Power Optimization ; Normal compilation ; Normal compilation ;
; Optimize Timing ; Normal compilation ; Normal compilation ;
; Optimize Timing for ECOs ; Off ; Off ;
; Regenerate full fit report during ECO compiles ; Off ; Off ;
; Optimize IOC Register Placement for Timing ; Normal ; Normal ;
; Limit to One Fitting Attempt ; Off ; Off ;
; Final Placement Optimizations ; Automatically ; Automatically ;
; Fitter Aggressive Routability Optimizations ; Automatically ; Automatically ;
; Fitter Initial Placement Seed ; 1 ; 1 ;
; PCI I/O ; Off ; Off ;
; Weak Pull-Up Resistor ; Off ; Off ;
; Enable Bus-Hold Circuitry ; Off ; Off ;
; Auto Global Memory Control Signals ; Off ; Off ;
; Auto Packed Registers ; Auto ; Auto ;
; Auto Delay Chains ; On ; On ;
; Perform Physical Synthesis for Combinational Logic for Fitting ; Off ; Off ;
; Perform Physical Synthesis for Combinational Logic for Performance ; Off ; Off ;
; Perform Register Duplication for Performance ; Off ; Off ;
; Perform Logic to Memory Mapping for Fitting ; Off ; Off ;
; Perform Register Retiming for Performance ; Off ; Off ;
; Perform Asynchronous Signal Pipelining ; Off ; Off ;
; Fitter Effort ; Auto Fit ; Auto Fit ;
; Physical Synthesis Effort Level ; Normal ; Normal ;
; Auto Global Clock ; On ; On ;
; Auto Global Register Control Signals ; On ; On ;
; Force Fitter to Avoid Periphery Placement Warnings ; Off ; Off ;
+----------------------------------------------------------------------------+--------------------------------+--------------------------------+
Parallel compilation was disabled, but you have multiple processors available. Enable parallel compilation to reduce compilation time.
+-------------------------------------+
; Parallel Compilation ;
+----------------------------+--------+
; Processors ; Number ;
+----------------------------+--------+
; Number detected on machine ; 4 ;
; Maximum allowed ; 1 ;
+----------------------------+--------+
+----------------------------------------------+
; Incremental Compilation Preservation Summary ;
+---------------------+------------------------+
; Type ; Value ;
+---------------------+------------------------+
; Placement (by node) ; ;
; -- Requested ; 0 / 622 ( 0.00 % ) ;
; -- Achieved ; 0 / 622 ( 0.00 % ) ;
; ; ;
; Routing (by net) ; ;
; -- Requested ; 0 / 0 ( 0.00 % ) ;
; -- Achieved ; 0 / 0 ( 0.00 % ) ;
+---------------------+------------------------+
+----------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Incremental Compilation Partition Settings ;
+--------------------------------+----------------+-------------------+-------------------------+------------------------+------------------------------+--------------------------------+
; Partition Name ; Partition Type ; Netlist Type Used ; Preservation Level Used ; Netlist Type Requested ; Preservation Level Requested ; Contents ;
+--------------------------------+----------------+-------------------+-------------------------+------------------------+------------------------------+--------------------------------+
; Top ; User-created ; Source File ; N/A ; Source File ; N/A ; ;
; hard_block:auto_generated_inst ; Auto-generated ; Source File ; N/A ; Source File ; N/A ; hard_block:auto_generated_inst ;
+--------------------------------+----------------+-------------------+-------------------------+------------------------+------------------------------+--------------------------------+
+------------------------------------------------------------------------------------------------------------+
; Incremental Compilation Placement Preservation ;
+--------------------------------+---------+-------------------+-------------------------+-------------------+
; Partition Name ; # Nodes ; # Preserved Nodes ; Preservation Level Used ; Netlist Type Used ;
+--------------------------------+---------+-------------------+-------------------------+-------------------+
; Top ; 619 ; 0 ; N/A ; Source File ;
; hard_block:auto_generated_inst ; 3 ; 0 ; N/A ; Source File ;
+--------------------------------+---------+-------------------+-------------------------+-------------------+
+--------------+
; Pin-Out File ;
+--------------+
The pin-out file can be found in G:/Workspaces/Quartus/Miniboard/Test/Test1.pin.
+--------------------------------------------------------------------+
; Fitter Resource Usage Summary ;
+---------------------------------------------+----------------------+
; Resource ; Usage ;
+---------------------------------------------+----------------------+
; Total logic elements ; 451 / 4,608 ( 10 % ) ;
; -- Combinational with no register ; 317 ;
; -- Register only ; 2 ;
; -- Combinational with a register ; 132 ;
; ; ;
; Logic element usage by number of LUT inputs ; ;
; -- 4 input functions ; 90 ;
; -- 3 input functions ; 175 ;
; -- <=2 input functions ; 184 ;
; -- Register only ; 2 ;
; ; ;
; Logic elements by mode ; ;
; -- normal mode ; 204 ;
; -- arithmetic mode ; 245 ;
; ; ;
; Total registers* ; 134 / 4,851 ( 3 % ) ;
; -- Dedicated logic registers ; 134 / 4,608 ( 3 % ) ;
; -- I/O registers ; 0 / 243 ( 0 % ) ;
; ; ;
; Total LABs: partially or completely used ; 37 / 288 ( 13 % ) ;
; User inserted logic elements ; 0 ;
; Virtual pins ; 0 ;
; I/O pins ; 32 / 89 ( 36 % ) ;
; -- Clock pins ; 1 / 4 ( 25 % ) ;
; ; ;
; Global signals ; 5 ;
; M4Ks ; 0 / 26 ( 0 % ) ;
; Total block memory bits ; 0 / 119,808 ( 0 % ) ;
; Total block memory implementation bits ; 0 / 119,808 ( 0 % ) ;
; Embedded Multiplier 9-bit elements ; 0 / 26 ( 0 % ) ;
; PLLs ; 0 / 2 ( 0 % ) ;
; Global clocks ; 5 / 8 ( 63 % ) ;
; JTAGs ; 0 / 1 ( 0 % ) ;
; ASMI blocks ; 0 / 1 ( 0 % ) ;
; CRC blocks ; 0 / 1 ( 0 % ) ;
; Average interconnect usage (total/H/V) ; 1% / 1% / 1% ;
; Peak interconnect usage (total/H/V) ; 3% / 2% / 3% ;
; Maximum fan-out node ; CLK_50~clkctrl ;
; Maximum fan-out ; 80 ;
; Highest non-global fan-out signal ; state_now.C ;
; Highest non-global fan-out ; 53 ;
; Total fan-out ; 1649 ;
; Average fan-out ; 2.64 ;
+---------------------------------------------+----------------------+
* Register count does not include registers inside RAM blocks or DSP blocks.
+----------------------------------------------------------------------------------------------------+
; Fitter Partition Statistics ;
+---------------------------------------------+---------------------+--------------------------------+
; Statistic ; Top ; hard_block:auto_generated_inst ;
+---------------------------------------------+---------------------+--------------------------------+
; Difficulty Clustering Region ; Low ; Low ;
; ; ; ;
; Total logic elements ; 451 / 4608 ( 10 % ) ; 0 / 4608 ( 0 % ) ;
; -- Combinational with no register ; 317 ; 0 ;
; -- Register only ; 2 ; 0 ;
; -- Combinational with a register ; 132 ; 0 ;
; ; ; ;
; Logic element usage by number of LUT inputs ; ; ;
; -- 4 input functions ; 90 ; 0 ;
; -- 3 input functions ; 175 ; 0 ;
; -- <=2 input functions ; 184 ; 0 ;
; -- Register only ; 2 ; 0 ;
; ; ; ;
; Logic elements by mode ; ; ;
; -- normal mode ; 204 ; 0 ;
; -- arithmetic mode ; 245 ; 0 ;
; ; ; ;
; Total registers ; 134 ; 0 ;
; -- Dedicated logic registers ; 134 / 4608 ( 3 % ) ; 0 / 4608 ( 0 % ) ;
; -- I/O registers ; 0 ; 0 ;
; ; ; ;
; Total LABs: partially or completely used ; 37 / 288 ( 13 % ) ; 0 / 288 ( 0 % ) ;
; ; ; ;
; Virtual pins ; 0 ; 0 ;
; I/O pins ; 32 ; 0 ;
; Embedded Multiplier 9-bit elements ; 0 / 26 ( 0 % ) ; 0 / 26 ( 0 % ) ;
; Total memory bits ; 0 ; 0 ;
; Total RAM block bits ; 0 ; 0 ;
; Clock control block ; 5 / 10 ( 50 % ) ; 0 / 10 ( 0 % ) ;
; ; ; ;
; Connections ; ; ;
; -- Input Connections ; 0 ; 0 ;
; -- Registered Input Connections ; 0 ; 0 ;
; -- Output Connections ; 0 ; 0 ;
; -- Registered Output Connections ; 0 ; 0 ;
; ; ; ;
; Internal Connections ; ; ;
; -- Total Connections ; 1649 ; 0 ;
; -- Registered Connections ; 450 ; 0 ;
; ; ; ;
; External Connections ; ; ;
; -- Top ; 0 ; 0 ;
; -- hard_block:auto_generated_inst ; 0 ; 0 ;
; ; ; ;
; Partition Interface ; ; ;
; -- Input Ports ; 12 ; 0 ;
; -- Output Ports ; 20 ; 0 ;
; -- Bidir Ports ; 0 ; 0 ;
; ; ; ;
; Registered Ports ; ; ;
; -- Registered Input Ports ; 0 ; 0 ;
; -- Registered Output Ports ; 0 ; 0 ;
; ; ; ;
; Port Connectivity ; ; ;
; -- Input Ports driven by GND ; 0 ; 0 ;
; -- Output Ports driven by GND ; 0 ; 0 ;
; -- Input Ports driven by VCC ; 0 ; 0 ;
; -- Output Ports driven by VCC ; 0 ; 0 ;
; -- Input Ports with no Source ; 0 ; 0 ;
; -- Output Ports with no Source ; 0 ; 0 ;
; -- Input Ports with no Fanout ; 0 ; 0 ;
; -- Output Ports with no Fanout ; 0 ; 0 ;
+---------------------------------------------+---------------------+--------------------------------+
+---------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Input Pins ;
+---------+-------+----------+--------------+--------------+-------------+-----------------------+--------------------+--------+----------------+---------------+-----------------+----------+--------------+--------------+-------------+----------------------+
; Name ; Pin # ; I/O Bank ; X coordinate ; Y coordinate ; Cell number ; Combinational Fan-Out ; Registered Fan-Out ; Global ; Input Register ; Power Up High ; PCI I/O Enabled ; Bus Hold ; Weak Pull Up ; I/O Standard ; Termination ; Location assigned by ;
+---------+-------+----------+--------------+--------------+-------------+-----------------------+--------------------+--------+----------------+---------------+-----------------+----------+--------------+--------------+-------------+----------------------+
; BCD0[0] ; 96 ; 3 ; 28 ; 9 ; 1 ; 21 ; 0 ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; Off ; User ;
; BCD0[1] ; 99 ; 3 ; 28 ; 11 ; 2 ; 19 ; 0 ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; Off ; User ;
; BCD0[2] ; 101 ; 3 ; 28 ; 11 ; 0 ; 19 ; 0 ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; Off ; User ;
; BCD0[3] ; 104 ; 3 ; 28 ; 12 ; 0 ; 16 ; 0 ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; Off ; User ;
; BCD1[0] ; 94 ; 3 ; 28 ; 9 ; 2 ; 17 ; 0 ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; Off ; User ;
; BCD1[1] ; 97 ; 3 ; 28 ; 9 ; 0 ; 16 ; 0 ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; Off ; User ;
; BCD1[2] ; 100 ; 3 ; 28 ; 11 ; 1 ; 17 ; 0 ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; Off ; User ;
; BCD1[3] ; 103 ; 3 ; 28 ; 12 ; 1 ; 16 ; 0 ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; Off ; User ;
; CLK_50 ; 17 ; 1 ; 0 ; 6 ; 0 ; 1 ; 0 ; yes ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; Off ; User ;
; NEG ; 93 ; 3 ; 28 ; 8 ; 0 ; 18 ; 0 ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; Off ; User ;
; PB ; 144 ; 2 ; 1 ; 14 ; 3 ; 0 ; 0 ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; Off ; User ;
; STB ; 71 ; 4 ; 26 ; 0 ; 1 ; 3 ; 0 ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; Off ; User ;
+---------+-------+----------+--------------+--------------+-------------+-----------------------+--------------------+--------+----------------+---------------+-----------------+----------+--------------+--------------+-------------+----------------------+
+---------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Output Pins ;
+---------+-------+----------+--------------+--------------+-------------+-----------------+------------------------+---------------+-----------------+------------+---------------+----------+--------------+--------------+------------------+-------------+----------------------+------+----------------------+---------------------+
; Name ; Pin # ; I/O Bank ; X coordinate ; Y coordinate ; Cell number ; Output Register ; Output Enable Register ; Power Up High ; PCI I/O Enabled ; Open Drain ; TRI Primitive ; Bus Hold ; Weak Pull Up ; I/O Standard ; Current Strength ; Termination ; Location assigned by ; Load ; Output Enable Source ; Output Enable Group ;
+---------+-------+----------+--------------+--------------+-------------+-----------------+------------------------+---------------+-----------------+------------+---------------+----------+--------------+--------------+------------------+-------------+----------------------+------+----------------------+---------------------+
; HEX0[0] ; 132 ; 2 ; 9 ; 14 ; 2 ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; User ; 0 pF ; - ; - ;
; HEX0[1] ; 126 ; 2 ; 14 ; 14 ; 1 ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; User ; 0 pF ; - ; - ;
; HEX0[2] ; 122 ; 2 ; 19 ; 14 ; 2 ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; User ; 0 pF ; - ; - ;
; HEX0[3] ; 120 ; 2 ; 19 ; 14 ; 0 ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; User ; 0 pF ; - ; - ;
; HEX0[4] ; 118 ; 2 ; 21 ; 14 ; 0 ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; User ; 0 pF ; - ; - ;
; HEX0[5] ; 114 ; 2 ; 26 ; 14 ; 2 ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; User ; 0 pF ; - ; - ;
; HEX0[6] ; 112 ; 2 ; 26 ; 14 ; 0 ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; User ; 0 pF ; - ; - ;
; HEX1[0] ; 133 ; 2 ; 7 ; 14 ; 0 ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; User ; 0 pF ; - ; - ;
; HEX1[1] ; 129 ; 2 ; 12 ; 14 ; 0 ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; User ; 0 pF ; - ; - ;
; HEX1[2] ; 125 ; 2 ; 14 ; 14 ; 0 ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; User ; 0 pF ; - ; - ;
; HEX1[3] ; 121 ; 2 ; 19 ; 14 ; 1 ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; User ; 0 pF ; - ; - ;
; HEX1[4] ; 119 ; 2 ; 21 ; 14 ; 1 ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; User ; 0 pF ; - ; - ;
; HEX1[5] ; 115 ; 2 ; 24 ; 14 ; 0 ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; User ; 0 pF ; - ; - ;
; HEX1[6] ; 113 ; 2 ; 26 ; 14 ; 1 ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; User ; 0 pF ; - ; - ;
; LED1 ; 3 ; 1 ; 0 ; 13 ; 2 ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; User ; 0 pF ; - ; - ;
; LED2 ; 7 ; 1 ; 0 ; 11 ; 1 ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; User ; 0 pF ; - ; - ;
; LED3 ; 9 ; 1 ; 0 ; 11 ; 3 ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; User ; 0 pF ; - ; - ;
; LEDN ; 134 ; 2 ; 7 ; 14 ; 1 ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; User ; 0 pF ; - ; - ;
; SRV0 ; 41 ; 4 ; 1 ; 0 ; 1 ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; User ; 0 pF ; - ; - ;
; SRV1 ; 40 ; 4 ; 1 ; 0 ; 2 ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; User ; 0 pF ; - ; - ;
+---------+-------+----------+--------------+--------------+-------------+-----------------+------------------------+---------------+-----------------+------------+---------------+----------+--------------+--------------+------------------+-------------+----------------------+------+----------------------+---------------------+
+------------------------------------------------------------+
; I/O Bank Usage ;
+----------+------------------+---------------+--------------+
; I/O Bank ; Usage ; VCCIO Voltage ; VREF Voltage ;
+----------+------------------+---------------+--------------+
; 1 ; 6 / 19 ( 32 % ) ; 3.3V ; -- ;
; 2 ; 16 / 23 ( 70 % ) ; 3.3V ; -- ;
; 3 ; 10 / 23 ( 43 % ) ; 3.3V ; -- ;
; 4 ; 3 / 24 ( 13 % ) ; 3.3V ; -- ;
+----------+------------------+---------------+--------------+
+------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; All Package Pins ;
+----------+------------+----------+------------------------------------------+--------+--------------+---------+------------+-----------------+----------+--------------+
; Location ; Pad Number ; I/O Bank ; Pin Name/Usage ; Dir. ; I/O Standard ; Voltage ; I/O Type ; User Assignment ; Bus Hold ; Weak Pull Up ;
+----------+------------+----------+------------------------------------------+--------+--------------+---------+------------+-----------------+----------+--------------+
; 1 ; 0 ; 1 ; ~ASDO~ / RESERVED_INPUT_WITH_WEAK_PULLUP ; input ; 3.3-V LVTTL ; ; Row I/O ; N ; no ; On ;
; 2 ; 1 ; 1 ; ~nCSO~ / RESERVED_INPUT_WITH_WEAK_PULLUP ; input ; 3.3-V LVTTL ; ; Row I/O ; N ; no ; On ;
; 3 ; 2 ; 1 ; LED1 ; output ; 3.3-V LVTTL ; ; Row I/O ; Y ; no ; Off ;
; 4 ; 3 ; 1 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; 5 ; ; 1 ; VCCIO1 ; power ; ; 3.3V ; -- ; ; -- ; -- ;
; 6 ; ; ; GND ; gnd ; ; ; -- ; ; -- ; -- ;
; 7 ; 10 ; 1 ; LED2 ; output ; 3.3-V LVTTL ; ; Row I/O ; Y ; no ; Off ;
; 8 ; 11 ; 1 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; 9 ; 12 ; 1 ; LED3 ; output ; 3.3-V LVTTL ; ; Row I/O ; Y ; no ; Off ;
; 10 ; 13 ; 1 ; #TDO ; output ; ; ; -- ; ; -- ; -- ;
; 11 ; 14 ; 1 ; #TMS ; input ; ; ; -- ; ; -- ; -- ;
; 12 ; 15 ; 1 ; #TCK ; input ; ; ; -- ; ; -- ; -- ;
; 13 ; 16 ; 1 ; #TDI ; input ; ; ; -- ; ; -- ; -- ;
; 14 ; 17 ; 1 ; ^DATA0 ; input ; ; ; -- ; ; -- ; -- ;
; 15 ; 18 ; 1 ; ^DCLK ; ; ; ; -- ; ; -- ; -- ;
; 16 ; 19 ; 1 ; ^nCE ; ; ; ; -- ; ; -- ; -- ;
; 17 ; 20 ; 1 ; CLK_50 ; input ; 3.3-V LVTTL ; ; Row I/O ; Y ; no ; Off ;
; 18 ; 21 ; 1 ; GND+ ; ; ; ; Row I/O ; ; -- ; -- ;
; 19 ; ; ; GND ; gnd ; ; ; -- ; ; -- ; -- ;
; 20 ; 22 ; 1 ; ^nCONFIG ; ; ; ; -- ; ; -- ; -- ;
; 21 ; 23 ; 1 ; GND+ ; ; ; ; Row I/O ; ; -- ; -- ;
; 22 ; 24 ; 1 ; GND+ ; ; ; ; Row I/O ; ; -- ; -- ;
; 23 ; ; 1 ; VCCIO1 ; power ; ; 3.3V ; -- ; ; -- ; -- ;
; 24 ; 25 ; 1 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; 25 ; 26 ; 1 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; 26 ; 27 ; 1 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; 27 ; 28 ; 1 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; 28 ; 32 ; 1 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; 29 ; ; 1 ; VCCIO1 ; power ; ; 3.3V ; -- ; ; -- ; -- ;
; 30 ; 40 ; 1 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; 31 ; 41 ; 1 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; 32 ; 42 ; 1 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; 33 ; ; ; GND ; gnd ; ; ; -- ; ; -- ; -- ;
; 34 ; ; ; GND_PLL1 ; gnd ; ; ; -- ; ; -- ; -- ;
; 35 ; ; ; VCCD_PLL1 ; power ; ; 1.2V ; -- ; ; -- ; -- ;
; 36 ; ; ; GND_PLL1 ; gnd ; ; ; -- ; ; -- ; -- ;
; 37 ; ; ; VCCA_PLL1 ; power ; ; 1.2V ; -- ; ; -- ; -- ;
; 38 ; ; ; GNDA_PLL1 ; gnd ; ; ; -- ; ; -- ; -- ;
; 39 ; ; ; GND ; gnd ; ; ; -- ; ; -- ; -- ;
; 40 ; 43 ; 4 ; SRV1 ; output ; 3.3-V LVTTL ; ; Column I/O ; Y ; no ; Off ;
; 41 ; 44 ; 4 ; SRV0 ; output ; 3.3-V LVTTL ; ; Column I/O ; Y ; no ; Off ;
; 42 ; 45 ; 4 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; 43 ; 46 ; 4 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; 44 ; 47 ; 4 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; 45 ; 48 ; 4 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; 46 ; ; 4 ; VCCIO4 ; power ; ; 3.3V ; -- ; ; -- ; -- ;
; 47 ; 49 ; 4 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; 48 ; 50 ; 4 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; 49 ; ; ; GND ; gnd ; ; ; -- ; ; -- ; -- ;
; 50 ; ; ; VCCINT ; power ; ; 1.2V ; -- ; ; -- ; -- ;
; 51 ; 52 ; 4 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; 52 ; 53 ; 4 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; 53 ; 57 ; 4 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; 54 ; ; 4 ; VCCIO4 ; power ; ; 3.3V ; -- ; ; -- ; -- ;
; 55 ; 58 ; 4 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; 56 ; ; ; GND ; gnd ; ; ; -- ; ; -- ; -- ;
; 57 ; 59 ; 4 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; 58 ; 60 ; 4 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; 59 ; 63 ; 4 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; 60 ; 64 ; 4 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; 61 ; ; ; GND ; gnd ; ; ; -- ; ; -- ; -- ;
; 62 ; ; ; VCCINT ; power ; ; 1.2V ; -- ; ; -- ; -- ;
; 63 ; 72 ; 4 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; 64 ; 75 ; 4 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; 65 ; 76 ; 4 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; 66 ; ; 4 ; VCCIO4 ; power ; ; 3.3V ; -- ; ; -- ; -- ;
; 67 ; 79 ; 4 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; 68 ; ; ; GND ; gnd ; ; ; -- ; ; -- ; -- ;
; 69 ; 80 ; 4 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; 70 ; 81 ; 4 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; 71 ; 82 ; 4 ; STB ; input ; 3.3-V LVTTL ; ; Column I/O ; Y ; no ; Off ;
; 72 ; 83 ; 4 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; 73 ; 84 ; 3 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; 74 ; 85 ; 3 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; 75 ; 86 ; 3 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; 76 ; 87 ; 3 ; ~LVDS41p/nCEO~ ; output ; 3.3-V LVTTL ; ; Row I/O ; N ; no ; Off ;
; 77 ; ; 3 ; VCCIO3 ; power ; ; 3.3V ; -- ; ; -- ; -- ;
; 78 ; ; ; GND ; gnd ; ; ; -- ; ; -- ; -- ;
; 79 ; 95 ; 3 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; 80 ; 97 ; 3 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; 81 ; 98 ; 3 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; 82 ; 99 ; 3 ; ^nSTATUS ; ; ; ; -- ; ; -- ; -- ;
; 83 ; 100 ; 3 ; ^CONF_DONE ; ; ; ; -- ; ; -- ; -- ;
; 84 ; 101 ; 3 ; ^MSEL1 ; ; ; ; -- ; ; -- ; -- ;
; 85 ; 102 ; 3 ; ^MSEL0 ; ; ; ; -- ; ; -- ; -- ;
; 86 ; 103 ; 3 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; 87 ; 104 ; 3 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; 88 ; 105 ; 3 ; GND+ ; ; ; ; Row I/O ; ; -- ; -- ;
; 89 ; 106 ; 3 ; GND+ ; ; ; ; Row I/O ; ; -- ; -- ;
; 90 ; 107 ; 3 ; GND+ ; ; ; ; Row I/O ; ; -- ; -- ;
; 91 ; 108 ; 3 ; GND+ ; ; ; ; Row I/O ; ; -- ; -- ;
; 92 ; 109 ; 3 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; 93 ; 110 ; 3 ; NEG ; input ; 3.3-V LVTTL ; ; Row I/O ; Y ; no ; Off ;
; 94 ; 111 ; 3 ; BCD1[0] ; input ; 3.3-V LVTTL ; ; Row I/O ; Y ; no ; Off ;
; 95 ; ; 3 ; VCCIO3 ; power ; ; 3.3V ; -- ; ; -- ; -- ;
; 96 ; 112 ; 3 ; BCD0[0] ; input ; 3.3-V LVTTL ; ; Row I/O ; Y ; no ; Off ;
; 97 ; 113 ; 3 ; BCD1[1] ; input ; 3.3-V LVTTL ; ; Row I/O ; Y ; no ; Off ;
; 98 ; ; ; GND ; gnd ; ; ; -- ; ; -- ; -- ;
; 99 ; 119 ; 3 ; BCD0[1] ; input ; 3.3-V LVTTL ; ; Row I/O ; Y ; no ; Off ;
; 100 ; 120 ; 3 ; BCD1[2] ; input ; 3.3-V LVTTL ; ; Row I/O ; Y ; no ; Off ;
; 101 ; 121 ; 3 ; BCD0[2] ; input ; 3.3-V LVTTL ; ; Row I/O ; Y ; no ; Off ;
; 102 ; ; 3 ; VCCIO3 ; power ; ; 3.3V ; -- ; ; -- ; -- ;
; 103 ; 125 ; 3 ; BCD1[3] ; input ; 3.3-V LVTTL ; ; Row I/O ; Y ; no ; Off ;
; 104 ; 126 ; 3 ; BCD0[3] ; input ; 3.3-V LVTTL ; ; Row I/O ; Y ; no ; Off ;
; 105 ; ; ; GND ; gnd ; ; ; -- ; ; -- ; -- ;
; 106 ; ; ; GND_PLL2 ; gnd ; ; ; -- ; ; -- ; -- ;
; 107 ; ; ; VCCD_PLL2 ; power ; ; 1.2V ; -- ; ; -- ; -- ;
; 108 ; ; ; GND_PLL2 ; gnd ; ; ; -- ; ; -- ; -- ;
; 109 ; ; ; VCCA_PLL2 ; power ; ; 1.2V ; -- ; ; -- ; -- ;
; 110 ; ; ; GNDA_PLL2 ; gnd ; ; ; -- ; ; -- ; -- ;
; 111 ; ; ; GND ; gnd ; ; ; -- ; ; -- ; -- ;
; 112 ; 127 ; 2 ; HEX0[6] ; output ; 3.3-V LVTTL ; ; Column I/O ; Y ; no ; Off ;
; 113 ; 128 ; 2 ; HEX1[6] ; output ; 3.3-V LVTTL ; ; Column I/O ; Y ; no ; Off ;
; 114 ; 129 ; 2 ; HEX0[5] ; output ; 3.3-V LVTTL ; ; Column I/O ; Y ; no ; Off ;
; 115 ; 130 ; 2 ; HEX1[5] ; output ; 3.3-V LVTTL ; ; Column I/O ; Y ; no ; Off ;
; 116 ; ; 2 ; VCCIO2 ; power ; ; 3.3V ; -- ; ; -- ; -- ;
; 117 ; ; ; GND ; gnd ; ; ; -- ; ; -- ; -- ;
; 118 ; 134 ; 2 ; HEX0[4] ; output ; 3.3-V LVTTL ; ; Column I/O ; Y ; no ; Off ;
; 119 ; 135 ; 2 ; HEX1[4] ; output ; 3.3-V LVTTL ; ; Column I/O ; Y ; no ; Off ;
; 120 ; 137 ; 2 ; HEX0[3] ; output ; 3.3-V LVTTL ; ; Column I/O ; Y ; no ; Off ;
; 121 ; 138 ; 2 ; HEX1[3] ; output ; 3.3-V LVTTL ; ; Column I/O ; Y ; no ; Off ;
; 122 ; 139 ; 2 ; HEX0[2] ; output ; 3.3-V LVTTL ; ; Column I/O ; Y ; no ; Off ;
; 123 ; ; ; GND ; gnd ; ; ; -- ; ; -- ; -- ;
; 124 ; ; ; VCCINT ; power ; ; 1.2V ; -- ; ; -- ; -- ;
; 125 ; 144 ; 2 ; HEX1[2] ; output ; 3.3-V LVTTL ; ; Column I/O ; Y ; no ; Off ;
; 126 ; 145 ; 2 ; HEX0[1] ; output ; 3.3-V LVTTL ; ; Column I/O ; Y ; no ; Off ;
; 127 ; ; 2 ; VCCIO2 ; power ; ; 3.3V ; -- ; ; -- ; -- ;
; 128 ; ; ; GND ; gnd ; ; ; -- ; ; -- ; -- ;
; 129 ; 148 ; 2 ; HEX1[1] ; output ; 3.3-V LVTTL ; ; Column I/O ; Y ; no ; Off ;
; 130 ; ; ; GND ; gnd ; ; ; -- ; ; -- ; -- ;
; 131 ; ; ; VCCINT ; power ; ; 1.2V ; -- ; ; -- ; -- ;
; 132 ; 153 ; 2 ; HEX0[0] ; output ; 3.3-V LVTTL ; ; Column I/O ; Y ; no ; Off ;
; 133 ; 154 ; 2 ; HEX1[0] ; output ; 3.3-V LVTTL ; ; Column I/O ; Y ; no ; Off ;
; 134 ; 155 ; 2 ; LEDN ; output ; 3.3-V LVTTL ; ; Column I/O ; Y ; no ; Off ;
; 135 ; 162 ; 2 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; 136 ; 163 ; 2 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; 137 ; 164 ; 2 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; 138 ; ; 2 ; VCCIO2 ; power ; ; 3.3V ; -- ; ; -- ; -- ;
; 139 ; 165 ; 2 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; 140 ; ; ; GND ; gnd ; ; ; -- ; ; -- ; -- ;
; 141 ; 166 ; 2 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; 142 ; 167 ; 2 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; 143 ; 168 ; 2 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; 144 ; 169 ; 2 ; PB ; input ; 3.3-V LVTTL ; ; Column I/O ; Y ; no ; Off ;
+----------+------------+----------+------------------------------------------+--------+--------------+---------+------------+-----------------+----------+--------------+
Note: Pin directions (input, output or bidir) are based on device operating in user mode.
+-------------------------------------------------------------------------------+
; Output Pin Default Load For Reported TCO ;
+----------------------------------+-------+------------------------------------+
; I/O Standard ; Load ; Termination Resistance ;
+----------------------------------+-------+------------------------------------+
; 3.3-V LVTTL ; 0 pF ; Not Available ;
; 3.3-V LVCMOS ; 0 pF ; Not Available ;
; 2.5 V ; 0 pF ; Not Available ;
; 1.8 V ; 0 pF ; Not Available ;
; 1.5 V ; 0 pF ; Not Available ;
; 3.3-V PCI ; 10 pF ; 25 Ohm (Parallel) ;
; 3.3-V PCI-X ; 10 pF ; 25 Ohm (Parallel) ;
; SSTL-2 Class I ; 0 pF ; 50 Ohm (Parallel), 25 Ohm (Serial) ;
; SSTL-2 Class II ; 0 pF ; 25 Ohm (Parallel), 25 Ohm (Serial) ;
; SSTL-18 Class I ; 0 pF ; 50 Ohm (Parallel), 25 Ohm (Serial) ;
; SSTL-18 Class II ; 0 pF ; 25 Ohm (Parallel), 25 Ohm (Serial) ;
; 1.5-V HSTL Class I ; 0 pF ; 50 Ohm (Parallel) ;
; 1.5-V HSTL Class II ; 0 pF ; 25 Ohm (Parallel) ;
; 1.8-V HSTL Class I ; 0 pF ; 50 Ohm (Parallel) ;
; 1.8-V HSTL Class II ; 0 pF ; 25 Ohm (Parallel) ;
; Differential SSTL-2 ; 0 pF ; (See SSTL-2) ;
; Differential 2.5-V SSTL Class II ; 0 pF ; (See SSTL-2 Class II) ;
; Differential 1.8-V SSTL Class I ; 0 pF ; (See 1.8-V SSTL Class I) ;
; Differential 1.8-V SSTL Class II ; 0 pF ; (See 1.8-V SSTL Class II) ;
; Differential 1.5-V HSTL Class I ; 0 pF ; (See 1.5-V HSTL Class I) ;
; Differential 1.5-V HSTL Class II ; 0 pF ; (See 1.5-V HSTL Class II) ;
; Differential 1.8-V HSTL Class I ; 0 pF ; (See 1.8-V HSTL Class I) ;
; Differential 1.8-V HSTL Class II ; 0 pF ; (See 1.8-V HSTL Class II) ;
; LVDS ; 0 pF ; 100 Ohm (Differential) ;
; mini-LVDS ; 0 pF ; 100 Ohm (Differential) ;
; RSDS ; 0 pF ; 100 Ohm (Differential) ;
; Simple RSDS ; 0 pF ; Not Available ;
; Differential LVPECL ; 0 pF ; 100 Ohm (Differential) ;
+----------------------------------+-------+------------------------------------+
Note: User assignments will override these defaults. The user specified values are listed in the Output Pins and Bidir Pins tables.
+------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Fitter Resource Utilization by Entity ;
+----------------------------+-------------+---------------------------+---------------+-------------+------+--------------+---------+-----------+------+--------------+--------------+-------------------+------------------+----------------------------+--------------+
; Compilation Hierarchy Node ; Logic Cells ; Dedicated Logic Registers ; I/O Registers ; Memory Bits ; M4Ks ; DSP Elements ; DSP 9x9 ; DSP 18x18 ; Pins ; Virtual Pins ; LUT-Only LCs ; Register-Only LCs ; LUT/Register LCs ; Full Hierarchy Name ; Library Name ;
+----------------------------+-------------+---------------------------+---------------+-------------+------+--------------+---------+-----------+------+--------------+--------------+-------------------+------------------+----------------------------+--------------+
; |Test1 ; 451 (198) ; 134 (54) ; 0 (0) ; 0 ; 0 ; 0 ; 0 ; 0 ; 32 ; 0 ; 317 (144) ; 2 (2) ; 132 (52) ; |Test1 ; ;
; |angle_selector:AS0| ; 96 (96) ; 0 (0) ; 0 (0) ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 96 (96) ; 0 (0) ; 0 (0) ; |Test1|angle_selector:AS0 ; ;
; |delay_clock:CLK2| ; 36 (36) ; 27 (27) ; 0 (0) ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 9 (9) ; 0 (0) ; 27 (27) ; |Test1|delay_clock:CLK2 ; ;
; |pwm_clock:CLK0| ; 71 (71) ; 26 (26) ; 0 (0) ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 45 (45) ; 0 (0) ; 26 (26) ; |Test1|pwm_clock:CLK0 ; ;
; |sampling_clock:CLK1| ; 36 (36) ; 27 (27) ; 0 (0) ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 9 (9) ; 0 (0) ; 27 (27) ; |Test1|sampling_clock:CLK1 ; ;
; |seg_display:SD0| ; 7 (7) ; 0 (0) ; 0 (0) ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 7 (7) ; 0 (0) ; 0 (0) ; |Test1|seg_display:SD0 ; ;
; |seg_display:SD1| ; 7 (7) ; 0 (0) ; 0 (0) ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; 7 (7) ; 0 (0) ; 0 (0) ; |Test1|seg_display:SD1 ; ;
+----------------------------+-------------+---------------------------+---------------+-------------+------+--------------+---------+-----------+------+--------------+--------------+-------------------+------------------+----------------------------+--------------+
Note: For table entries with two numbers listed, the numbers in parentheses indicate the number of resources of the given type used by the specific entity alone. The numbers listed outside of parentheses indicate the total resources of the given type used by the specific entity and all of its sub-entities in the hierarchy.
+----------------------------------------------------------------------------------+
; Delay Chain Summary ;
+---------+----------+---------------+---------------+-----------------------+-----+
; Name ; Pin Type ; Pad to Core 0 ; Pad to Core 1 ; Pad to Input Register ; TCO ;
+---------+----------+---------------+---------------+-----------------------+-----+
; PB ; Input ; (0) 170 ps ; (0) 170 ps ; -- ; -- ;
; HEX0[6] ; Output ; -- ; -- ; -- ; -- ;
; HEX0[5] ; Output ; -- ; -- ; -- ; -- ;
; HEX0[4] ; Output ; -- ; -- ; -- ; -- ;
; HEX0[3] ; Output ; -- ; -- ; -- ; -- ;
; HEX0[2] ; Output ; -- ; -- ; -- ; -- ;
; HEX0[1] ; Output ; -- ; -- ; -- ; -- ;
; HEX0[0] ; Output ; -- ; -- ; -- ; -- ;
; HEX1[6] ; Output ; -- ; -- ; -- ; -- ;
; HEX1[5] ; Output ; -- ; -- ; -- ; -- ;
; HEX1[4] ; Output ; -- ; -- ; -- ; -- ;
; HEX1[3] ; Output ; -- ; -- ; -- ; -- ;
; HEX1[2] ; Output ; -- ; -- ; -- ; -- ;
; HEX1[1] ; Output ; -- ; -- ; -- ; -- ;
; HEX1[0] ; Output ; -- ; -- ; -- ; -- ;
; LED1 ; Output ; -- ; -- ; -- ; -- ;
; LED2 ; Output ; -- ; -- ; -- ; -- ;
; LED3 ; Output ; -- ; -- ; -- ; -- ;
; SRV0 ; Output ; -- ; -- ; -- ; -- ;
; SRV1 ; Output ; -- ; -- ; -- ; -- ;
; LEDN ; Output ; -- ; -- ; -- ; -- ;
; BCD0[3] ; Input ; (6) 2523 ps ; (6) 2523 ps ; -- ; -- ;
; BCD0[2] ; Input ; (6) 2523 ps ; (6) 2523 ps ; -- ; -- ;
; BCD0[1] ; Input ; (6) 2523 ps ; (6) 2523 ps ; -- ; -- ;
; BCD0[0] ; Input ; (6) 2523 ps ; (6) 2523 ps ; -- ; -- ;
; BCD1[3] ; Input ; (6) 2523 ps ; (6) 2523 ps ; -- ; -- ;
; BCD1[2] ; Input ; (6) 2523 ps ; (6) 2523 ps ; -- ; -- ;
; BCD1[1] ; Input ; (6) 2523 ps ; (6) 2523 ps ; -- ; -- ;
; BCD1[0] ; Input ; (6) 2523 ps ; (6) 2523 ps ; -- ; -- ;
; NEG ; Input ; (6) 2523 ps ; (6) 2523 ps ; -- ; -- ;
; STB ; Input ; (6) 2514 ps ; (6) 2514 ps ; -- ; -- ;
; CLK_50 ; Input ; (0) 171 ps ; (0) 171 ps ; -- ; -- ;
+---------+----------+---------------+---------------+-----------------------+-----+
+-----------------------------------------------------------------+
; Pad To Core Delay Chain Fanout ;
+-----------------------------------+-------------------+---------+
; Source Pin / Fanout ; Pad To Core Index ; Setting ;
+-----------------------------------+-------------------+---------+
; PB ; ; ;
; BCD0[3] ; ; ;
; - seg_display:SD0|Mux6~0 ; 0 ; 6 ;
; - seg_display:SD0|Mux5~0 ; 0 ; 6 ;
; - seg_display:SD0|Mux4~0 ; 0 ; 6 ;
; - seg_display:SD0|Mux3~0 ; 0 ; 6 ;
; - seg_display:SD0|Mux2~0 ; 0 ; 6 ;
; - seg_display:SD0|Mux1~0 ; 0 ; 6 ;
; - seg_display:SD0|Mux0~0 ; 0 ; 6 ;
; - angle_selector:AS0|Mux0~0 ; 0 ; 6 ;
; - angle_selector:AS0|Mux1~0 ; 0 ; 6 ;
; - angle_selector:AS0|Mux2~0 ; 0 ; 6 ;
; - angle_selector:AS0|Mux3~0 ; 0 ; 6 ;
; - angle_selector:AS0|Mux4~0 ; 0 ; 6 ;
; - angle_selector:AS0|Mux5~0 ; 0 ; 6 ;
; - angle_selector:AS0|Mux6~0 ; 0 ; 6 ;
; - angle_selector:AS0|Mux7~0 ; 0 ; 6 ;
; - angle_selector:AS0|Mux12~0 ; 0 ; 6 ;
; BCD0[2] ; ; ;
; - angle_selector:AS0|Add2~2 ; 0 ; 6 ;
; - seg_display:SD0|Mux6~0 ; 0 ; 6 ;
; - seg_display:SD0|Mux5~0 ; 0 ; 6 ;
; - seg_display:SD0|Mux4~0 ; 0 ; 6 ;
; - seg_display:SD0|Mux3~0 ; 0 ; 6 ;
; - seg_display:SD0|Mux2~0 ; 0 ; 6 ;
; - seg_display:SD0|Mux1~0 ; 0 ; 6 ;
; - seg_display:SD0|Mux0~0 ; 0 ; 6 ;
; - angle_selector:AS0|Mux0~0 ; 0 ; 6 ;
; - angle_selector:AS0|Mux1~0 ; 0 ; 6 ;
; - angle_selector:AS0|Mux2~0 ; 0 ; 6 ;
; - angle_selector:AS0|Mux3~0 ; 0 ; 6 ;
; - angle_selector:AS0|Mux4~0 ; 0 ; 6 ;
; - angle_selector:AS0|Mux5~0 ; 0 ; 6 ;
; - angle_selector:AS0|Mux6~0 ; 0 ; 6 ;
; - angle_selector:AS0|Mux7~0 ; 0 ; 6 ;
; - angle_selector:AS0|Mux12~0 ; 0 ; 6 ;
; - angle_selector:AS0|Mux9~0 ; 0 ; 6 ;
; - angle_selector:AS0|Mux11~0 ; 0 ; 6 ;
; BCD0[1] ; ; ;
; - angle_selector:AS0|Add2~4 ; 0 ; 6 ;
; - seg_display:SD0|Mux6~0 ; 0 ; 6 ;
; - seg_display:SD0|Mux5~0 ; 0 ; 6 ;
; - seg_display:SD0|Mux4~0 ; 0 ; 6 ;
; - seg_display:SD0|Mux3~0 ; 0 ; 6 ;
; - seg_display:SD0|Mux2~0 ; 0 ; 6 ;
; - seg_display:SD0|Mux1~0 ; 0 ; 6 ;
; - seg_display:SD0|Mux0~0 ; 0 ; 6 ;
; - angle_selector:AS0|Mux0~0 ; 0 ; 6 ;
; - angle_selector:AS0|Mux1~0 ; 0 ; 6 ;
; - angle_selector:AS0|Mux2~0 ; 0 ; 6 ;
; - angle_selector:AS0|Mux3~0 ; 0 ; 6 ;
; - angle_selector:AS0|Mux4~0 ; 0 ; 6 ;
; - angle_selector:AS0|Mux5~0 ; 0 ; 6 ;
; - angle_selector:AS0|Mux6~0 ; 0 ; 6 ;
; - angle_selector:AS0|Mux7~0 ; 0 ; 6 ;
; - angle_selector:AS0|Mux12~0 ; 0 ; 6 ;
; - angle_selector:AS0|Mux9~0 ; 0 ; 6 ;
; - angle_selector:AS0|Mux10~0 ; 0 ; 6 ;
; BCD0[0] ; ; ;
; - angle_selector:AS0|Add2~4 ; 1 ; 6 ;
; - angle_selector:AS0|Add2~2 ; 1 ; 6 ;
; - seg_display:SD0|Mux6~0 ; 1 ; 6 ;
; - seg_display:SD0|Mux5~0 ; 1 ; 6 ;
; - seg_display:SD0|Mux4~0 ; 1 ; 6 ;
; - seg_display:SD0|Mux3~0 ; 1 ; 6 ;
; - seg_display:SD0|Mux2~0 ; 1 ; 6 ;
; - seg_display:SD0|Mux1~0 ; 1 ; 6 ;
; - seg_display:SD0|Mux0~0 ; 1 ; 6 ;
; - angle_selector:AS0|Mux0~0 ; 1 ; 6 ;
; - angle_selector:AS0|Mux1~0 ; 1 ; 6 ;
; - angle_selector:AS0|Mux2~0 ; 1 ; 6 ;
; - angle_selector:AS0|Mux3~0 ; 1 ; 6 ;
; - angle_selector:AS0|Mux4~0 ; 1 ; 6 ;
; - angle_selector:AS0|Mux5~0 ; 1 ; 6 ;
; - angle_selector:AS0|Mux6~0 ; 1 ; 6 ;
; - angle_selector:AS0|Mux7~0 ; 1 ; 6 ;
; - angle_selector:AS0|Mux12~0 ; 1 ; 6 ;
; - angle_selector:AS0|Mux9~0 ; 1 ; 6 ;
; - angle_selector:AS0|Mux10~0 ; 1 ; 6 ;
; - angle_selector:AS0|Mux11~0 ; 1 ; 6 ;
; BCD1[3] ; ; ;
; - seg_display:SD1|Mux6~0 ; 1 ; 6 ;
; - seg_display:SD1|Mux5~0 ; 1 ; 6 ;
; - seg_display:SD1|Mux4~0 ; 1 ; 6 ;
; - seg_display:SD1|Mux3~0 ; 1 ; 6 ;
; - seg_display:SD1|Mux2~0 ; 1 ; 6 ;
; - seg_display:SD1|Mux1~0 ; 1 ; 6 ;
; - seg_display:SD1|Mux0~0 ; 1 ; 6 ;
; - angle_selector:AS0|Mux13~0 ; 1 ; 6 ;
; - angle_selector:AS0|Mux14~0 ; 1 ; 6 ;
; - angle_selector:AS0|Mux15~0 ; 1 ; 6 ;
; - angle_selector:AS0|Mux16~0 ; 1 ; 6 ;
; - angle_selector:AS0|Mux18~0 ; 1 ; 6 ;
; - angle_selector:AS0|Mux19~0 ; 1 ; 6 ;
; - angle_selector:AS0|Mux20~0 ; 1 ; 6 ;
; - angle_selector:AS0|Mux21~0 ; 1 ; 6 ;
; - angle_selector:AS0|Mux23~0 ; 1 ; 6 ;
; BCD1[2] ; ; ;
; - seg_display:SD1|Mux6~0 ; 1 ; 6 ;
; - seg_display:SD1|Mux5~0 ; 1 ; 6 ;
; - seg_display:SD1|Mux4~0 ; 1 ; 6 ;
; - seg_display:SD1|Mux3~0 ; 1 ; 6 ;
; - seg_display:SD1|Mux2~0 ; 1 ; 6 ;
; - seg_display:SD1|Mux1~0 ; 1 ; 6 ;
; - seg_display:SD1|Mux0~0 ; 1 ; 6 ;
; - angle_selector:AS0|Mux13~0 ; 1 ; 6 ;
; - angle_selector:AS0|Mux14~0 ; 1 ; 6 ;
; - angle_selector:AS0|Mux15~0 ; 1 ; 6 ;
; - angle_selector:AS0|Mux16~0 ; 1 ; 6 ;
; - angle_selector:AS0|Mux18~0 ; 1 ; 6 ;
; - angle_selector:AS0|Mux19~0 ; 1 ; 6 ;
; - angle_selector:AS0|Mux20~0 ; 1 ; 6 ;
; - angle_selector:AS0|Mux21~0 ; 1 ; 6 ;
; - angle_selector:AS0|Mux22~0 ; 1 ; 6 ;
; - angle_selector:AS0|Mux23~0 ; 1 ; 6 ;
; BCD1[1] ; ; ;
; - seg_display:SD1|Mux6~0 ; 0 ; 6 ;
; - seg_display:SD1|Mux5~0 ; 0 ; 6 ;
; - seg_display:SD1|Mux4~0 ; 0 ; 6 ;
; - seg_display:SD1|Mux3~0 ; 0 ; 6 ;
; - seg_display:SD1|Mux2~0 ; 0 ; 6 ;
; - seg_display:SD1|Mux1~0 ; 0 ; 6 ;
; - seg_display:SD1|Mux0~0 ; 0 ; 6 ;
; - angle_selector:AS0|Mux13~0 ; 0 ; 6 ;
; - angle_selector:AS0|Mux14~0 ; 0 ; 6 ;
; - angle_selector:AS0|Mux15~0 ; 0 ; 6 ;
; - angle_selector:AS0|Mux16~0 ; 0 ; 6 ;
; - angle_selector:AS0|Mux18~0 ; 0 ; 6 ;
; - angle_selector:AS0|Mux19~0 ; 0 ; 6 ;
; - angle_selector:AS0|Mux20~0 ; 0 ; 6 ;
; - angle_selector:AS0|Mux21~0 ; 0 ; 6 ;
; - angle_selector:AS0|Mux23~0 ; 0 ; 6 ;
; BCD1[0] ; ; ;
; - seg_display:SD1|Mux6~0 ; 0 ; 6 ;
; - seg_display:SD1|Mux5~0 ; 0 ; 6 ;
; - seg_display:SD1|Mux4~0 ; 0 ; 6 ;
; - seg_display:SD1|Mux3~0 ; 0 ; 6 ;
; - seg_display:SD1|Mux2~0 ; 0 ; 6 ;
; - seg_display:SD1|Mux1~0 ; 0 ; 6 ;
; - seg_display:SD1|Mux0~0 ; 0 ; 6 ;
; - angle_selector:AS0|Mux13~0 ; 0 ; 6 ;
; - angle_selector:AS0|Mux14~0 ; 0 ; 6 ;
; - angle_selector:AS0|Mux15~0 ; 0 ; 6 ;
; - angle_selector:AS0|Mux16~0 ; 0 ; 6 ;
; - angle_selector:AS0|Mux18~0 ; 0 ; 6 ;
; - angle_selector:AS0|Mux19~0 ; 0 ; 6 ;
; - angle_selector:AS0|Mux20~0 ; 0 ; 6 ;
; - angle_selector:AS0|Mux21~0 ; 0 ; 6 ;
; - angle_selector:AS0|Mux22~0 ; 0 ; 6 ;
; - angle_selector:AS0|Mux23~0 ; 0 ; 6 ;
; NEG ; ; ;
; - angle_selector:AS0|Add1~36 ; 0 ; 6 ;
; - angle_selector:AS0|Add1~37 ; 0 ; 6 ;
; - angle_selector:AS0|Add1~38 ; 0 ; 6 ;
; - angle_selector:AS0|Add1~39 ; 0 ; 6 ;
; - angle_selector:AS0|Add1~40 ; 0 ; 6 ;
; - angle_selector:AS0|Add1~41 ; 0 ; 6 ;
; - angle_selector:AS0|Add1~42 ; 0 ; 6 ;
; - angle_selector:AS0|Add1~43 ; 0 ; 6 ;
; - angle_selector:AS0|Add1~44 ; 0 ; 6 ;
; - angle_selector:AS0|Add1~45 ; 0 ; 6 ;
; - angle_selector:AS0|Add1~46 ; 0 ; 6 ;
; - angle_selector:AS0|Add1~47 ; 0 ; 6 ;
; - angle_selector:AS0|Add1~48 ; 0 ; 6 ;
; - angle_selector:AS0|Add1~49 ; 0 ; 6 ;
; - angle_selector:AS0|Add1~50 ; 0 ; 6 ;
; - angle_selector:AS0|Add1~51 ; 0 ; 6 ;
; - angle_selector:AS0|Add1~52 ; 0 ; 6 ;
; - LEDN ; 0 ; 6 ;
; STB ; ; ;
; - state_now.A ; 0 ; 6 ;
; - state_now.B ; 0 ; 6 ;
; - state_now.C ; 0 ; 6 ;
; CLK_50 ; ; ;
+-----------------------------------+-------------------+---------+
+----------------------------------------------------------------------------------------------------------------------------------------------------------+
; Control Signals ;
+------------------------------+-------------------+---------+--------------+--------+----------------------+------------------+---------------------------+
; Name ; Location ; Fan-Out ; Usage ; Global ; Global Resource Used ; Global Line Name ; Enable Signal Source Name ;
+------------------------------+-------------------+---------+--------------+--------+----------------------+------------------+---------------------------+
; CLK_50 ; PIN_17 ; 80 ; Clock ; yes ; Global Clock ; GCLK2 ; -- ;
; STB ; PIN_71 ; 3 ; Clock enable ; no ; -- ; -- ; -- ;
; delay_clock:CLK2|Equal0~8 ; LCCOMB_X14_Y10_N0 ; 27 ; Async. clear ; no ; -- ; -- ; -- ;
; delay_clock:CLK2|ovf ; LCFF_X14_Y10_N17 ; 51 ; Clock ; yes ; Global Clock ; GCLK5 ; -- ;
; pwm_clock:CLK0|Equal0~8 ; LCCOMB_X21_Y6_N26 ; 28 ; Async. clear ; no ; -- ; -- ; -- ;
; sampling_clock:CLK1|Equal0~8 ; LCCOMB_X12_Y5_N30 ; 27 ; Async. clear ; no ; -- ; -- ; -- ;
; sampling_clock:CLK1|ovf ; LCFF_X13_Y5_N1 ; 3 ; Clock ; yes ; Global Clock ; GCLK1 ; -- ;
; state_now.A ; LCFF_X18_Y9_N27 ; 18 ; Latch enable ; yes ; Global Clock ; GCLK7 ; -- ;
; state_now.B ; LCFF_X27_Y7_N7 ; 18 ; Latch enable ; yes ; Global Clock ; GCLK6 ; -- ;
; state_now.C ; LCFF_X18_Y9_N17 ; 53 ; Clock enable ; no ; -- ; -- ; -- ;
+------------------------------+-------------------+---------+--------------+--------+----------------------+------------------+---------------------------+
+----------------------------------------------------------------------------------------------------------------------------+
; Global & Other Fast Signals ;
+-------------------------+------------------+---------+----------------------+------------------+---------------------------+
; Name ; Location ; Fan-Out ; Global Resource Used ; Global Line Name ; Enable Signal Source Name ;
+-------------------------+------------------+---------+----------------------+------------------+---------------------------+
; CLK_50 ; PIN_17 ; 80 ; Global Clock ; GCLK2 ; -- ;
; delay_clock:CLK2|ovf ; LCFF_X14_Y10_N17 ; 51 ; Global Clock ; GCLK5 ; -- ;
; sampling_clock:CLK1|ovf ; LCFF_X13_Y5_N1 ; 3 ; Global Clock ; GCLK1 ; -- ;
; state_now.A ; LCFF_X18_Y9_N27 ; 18 ; Global Clock ; GCLK7 ; -- ;
; state_now.B ; LCFF_X27_Y7_N7 ; 18 ; Global Clock ; GCLK6 ; -- ;
+-------------------------+------------------+---------+----------------------+------------------+---------------------------+
+------------------------------------------+
; Non-Global High Fan-Out Signals ;
+--------------------------------+---------+
; Name ; Fan-Out ;
+--------------------------------+---------+
; state_now.C ; 53 ;
; pwm_clock:CLK0|Equal0~8 ; 28 ;
; delay_clock:CLK2|Equal0~8 ; 27 ;
; sampling_clock:CLK1|Equal0~8 ; 27 ;
; LessThan1~46 ; 25 ;
; LessThan0~46 ; 25 ;
; BCD0[0] ; 21 ;
; BCD0[1] ; 19 ;
; BCD0[2] ; 19 ;
; NEG ; 18 ;
; BCD1[0] ; 17 ;
; BCD1[2] ; 17 ;
; BCD1[1] ; 16 ;
; BCD1[3] ; 16 ;
; BCD0[3] ; 16 ;
; temp_angle_1[25] ; 8 ;
; temp_angle_0[25] ; 8 ;
; pwm_clock:CLK0|ctr[0] ; 5 ;
; angle_val_0[0] ; 5 ;
; angle_selector:AS0|Mux12~0 ; 4 ;
; angle_selector:AS0|Mux18~0 ; 4 ;
; angle_val_1[22] ; 4 ;
; angle_val_1[23] ; 4 ;
; angle_val_1[20] ; 4 ;
; angle_val_1[21] ; 4 ;
; angle_val_1[18] ; 4 ;
; angle_val_1[19] ; 4 ;
; angle_val_1[16] ; 4 ;
; angle_val_1[17] ; 4 ;
; angle_val_1[24] ; 4 ;
; angle_val_1[25] ; 4 ;
; angle_val_1[14] ; 4 ;
; angle_val_1[15] ; 4 ;
; angle_val_1[13] ; 4 ;
; angle_val_1[12] ; 4 ;
; angle_val_1[10] ; 4 ;
; angle_val_1[11] ; 4 ;
; angle_val_1[8] ; 4 ;
; angle_val_1[9] ; 4 ;
; angle_val_1[7] ; 4 ;
; angle_val_1[6] ; 4 ;
; angle_val_1[5] ; 4 ;
; angle_val_1[4] ; 4 ;
; angle_val_1[3] ; 4 ;
; angle_val_1[2] ; 4 ;
; pwm_clock:CLK0|ctr[22] ; 4 ;
; pwm_clock:CLK0|ctr[23] ; 4 ;
; pwm_clock:CLK0|ctr[20] ; 4 ;
; pwm_clock:CLK0|ctr[21] ; 4 ;
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; pwm_clock:CLK0|ctr[13] ; 4 ;
; pwm_clock:CLK0|ctr[12] ; 4 ;
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; pwm_clock:CLK0|ctr[5] ; 4 ;
; pwm_clock:CLK0|ctr[4] ; 4 ;
; pwm_clock:CLK0|ctr[3] ; 4 ;
; pwm_clock:CLK0|ctr[2] ; 4 ;
; pwm_clock:CLK0|ctr[1] ; 4 ;
; STB ; 3 ;
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; angle_selector:AS0|Mux7~0 ; 3 ;
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; angle_val_0[24] ; 3 ;
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; angle_val_0[10] ; 3 ;
; angle_val_0[11] ; 3 ;
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; temp_angle_1[12] ; 2 ;
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; temp_angle_1[15] ; 2 ;
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